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PWOK为高电平,Q60导通拉低Q59的B极,Q59截止,Q61的G极不被拉低。这时5VSB经电阻R544置高Q61的G极使其D-S导通,形成NB或DDR2.5V供电。供电的稳定性通过R556和R481分压得到2.45V电压反馈给Q62,由其C极控制Q61导通的饱和程度,进而控制DDR2.5V的稳定性。
当PWOK为低电平时,Q60截止。这时Q59的C-E极导通,经C极拉低Q61的G极,Q61截止,其S极输出为0V。
分析是否正确?欢迎大家指正。
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